作者：夏雨,姚素英,聂凯明,徐江涛 单位：中国微米纳米技术学会;东南大学 出版：《传感技术学报》2015年第03期 页数：7页  （PDF与DOC格式可能不同） PDF编号：PDFCGJS2015030130 DOC编号：DOCCGJS2015030139 下载格式：PDF + Word/doc 文字可复制、可编辑

    • 提出了一种适用于TDI-CIS(时间延迟积分CMOS图像传感器)的模拟域流水采样列级运放共享累加器结构。提出的这种模拟累加器结构应用流水采样结构在不改变运放速率的前提下，将累加器的速率提升为传统累加器的2倍；采用积分电容列运放共享技术将n级TDI-CIS所需的运放个数减少至采用传统累加器所需个数的1/n。分析了流水采样累加器结构的原理以及输出噪声。使用标准0.18μm CMOS工艺进行了电路设计。仿真结果显示，提出的模拟累加器结构功耗为0.29m W，采样率为2 Msample/s。结果表明流水采样列级运放共享累加器结构在保持低电路面积和功耗的同时，可将TDI-CIS最大可达到的行频增加一倍，更适于高速扫描的应用环境。

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